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h ** p: / / w * w.ubicom.com/products/ip3000/ip3000_processors.html
h ** p: / / w * w.ubicom.com/pdfs/products/ip3000/processor/IP3K-DTB-3023-101.pdf
La IP3023 ha sido diseñado desde cero para los requisitos exclusivos de las redes inalámbricas y procesamiento de paquetes.Técnicas como la única de ocho manera multithreading, cero contexto
del ciclo de conmutación y una memoria a la arquitectura de memoria es necesario entregar el rendimiento,
la reducción de costos y el tamaño requerido por las aplicaciones inalámbricas.
Ocho posiciones multithreading permite el dispositivo para funcionar eficazmente como ocho procesadores separados, donde cada hilo se le puede asignar una velocidad variable de 0 - 250 MHz en incrementos de 3,9 Mhz.Hasta seis hilos puede ser dedicado a programas de I / O.Además, el procesamiento de paquetes, porque no exige el acceso continuo a los datos por la CPU, la memoria caché en el chip no es necesario.El uso de una memoria a la arquitectura de memoria permite que los paquetes que se procesan directamente en el chip de memoria, eliminando la necesidad de cachés, y evitar la falta de caché, que reducen el rendimiento.De memoria a la memoria también se elimina el costoso silicio necesario para cachés y fuera de chip de memoria.
Estas capacidades permiten a entregar la IP3023 alambre-velocidad de ejecución en un cuarto la superficie de silicio y que requiere sólo el 10 por ciento de fuera de chip de memoria empleada por las arquitecturas tradicionales.Esto conduce a una disminución general de la factura de materiales (BOM) para diseños basados en la IP3023.
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La IP3023 ha sido diseñado desde cero para los requisitos exclusivos de las redes inalámbricas y procesamiento de paquetes.Técnicas como la única de ocho manera multithreading, cero contexto
del ciclo de conmutación y una memoria a la arquitectura de memoria es necesario entregar el rendimiento,
la reducción de costos y el tamaño requerido por las aplicaciones inalámbricas.
Ocho posiciones multithreading permite el dispositivo para funcionar eficazmente como ocho procesadores separados, donde cada hilo se le puede asignar una velocidad variable de 0 - 250 MHz en incrementos de 3,9 Mhz.Hasta seis hilos puede ser dedicado a programas de I / O.Además, el procesamiento de paquetes, porque no exige el acceso continuo a los datos por la CPU, la memoria caché en el chip no es necesario.El uso de una memoria a la arquitectura de memoria permite que los paquetes que se procesan directamente en el chip de memoria, eliminando la necesidad de cachés, y evitar la falta de caché, que reducen el rendimiento.De memoria a la memoria también se elimina el costoso silicio necesario para cachés y fuera de chip de memoria.
Estas capacidades permiten a entregar la IP3023 alambre-velocidad de ejecución en un cuarto la superficie de silicio y que requiere sólo el 10 por ciento de fuera de chip de memoria empleada por las arquitecturas tradicionales.Esto conduce a una disminución general de la factura de materiales (BOM) para diseños basados en la IP3023.