A
ASIC_intl
Guest
¿Cómo diseñar una división por 3 / 2 contra el que se sintetizable?
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N
natg9
Guest
Hola amigoTengo un documento sobre el mismo
pero debido a algunos im razón recibiendo este error msg de EDABOARD
Lo sentimos, este archivo ya ha sido publicado!Mejor copia y pegue el siguiente enlace en su puesto, donde se encuentra el mismo archivo:
http://www.edaboard.com/viewtopic.php?p=280661 # 280661así que me da ur email ID i ll post it to urecuerdos
NatG
pero debido a algunos im razón recibiendo este error msg de EDABOARD
Lo sentimos, este archivo ya ha sido publicado!Mejor copia y pegue el siguiente enlace en su puesto, donde se encuentra el mismo archivo:
http://www.edaboard.com/viewtopic.php?p=280661 # 280661así que me da ur email ID i ll post it to urecuerdos
NatG
A
AdvaRes
Guest
Hola,
Si utiliza el Clock_Dividers_Made_Easy.pdf documento, es muy útil.Usted puede hacer fácilmente 1 / 2, 3 / 2 y 1 / 5 divisor con 50% de su
Si utiliza el Clock_Dividers_Made_Easy.pdf documento, es muy útil.Usted puede hacer fácilmente 1 / 2, 3 / 2 y 1 / 5 divisor con 50% de su
A
ASIC_intl
Guest
Can u hacer una división por 3 / 2 con la lucha contra el uso de dos FSM entre ellos uno opera en el borde positivo y el otro extremo en negativo.
El enfoque clock_divider_made_easy.pdf es diferente.
El enfoque clock_divider_made_easy.pdf es diferente.
S
speedforu
Guest
<img src="http://images.elektroda.net/10_1219831540.jpg" border="0" alt="designing divide by 3/2 counter" title="el diseño de dividir por 3 / 2 contra el"/>LEP es el pulso se genera cada vez que Estados Federados de Micronesia contador de los bordes del reloj se convierte en 0.lep_d1 es la salida del registro de entrada con LEP registró en el borde negativo.La salida es una O simple de estas 2 señales.
A
ASIC_intl
Guest
queremos una brecha en un 3 / 2, no frente a una brecha en un 3 contra el diagrama, cuyo calendario ha sido elaborado.
D
dcreddy1980
Guest
Hola ASIC_intl, ¿Me puede dar una razón por la do u wanna go para el enfoque de la FSM dividir por 3 / 2 generación de reloj?
A
ASIC_intl
Guest
No hay ninguna razón en particular.Se puede hacer de esa manera también.El camino sugerido por el documento de STMicroelectronics es un enfoque tradicional.
Can u resolver de la manera que me dijo!
Can u resolver de la manera que me dijo!
P
Peter Chang
Guest
Creo que necesita un PLL.Peter