aprox desplazamiento de reloj útil

[mallikmarasu]

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[vlsi_whiz]

Considere la posibilidad de un diseño con 3 flip-flops, todas las entradas de reloj alimentado mediante la misma señal de reloj.Ahora, el borde de reloj que se ve FF2 se puede retrasar a la de FF1 y también lo que ve FF3 puede retrasarse con respecto a FF2.

Este retraso en la señal de reloj entre dos flip-flops adyacentes (FF1 - FF2 o FF2-FF3) se llama Clock Skew.Esto, si se inclina el reloj, los bordes del reloj llegan en momentos diferentes a la lógica secuencial.Esto puede causar el momento, así como problemas en metaestabilidad ckts secuencial.

Existen 2 métodos para minimizar el desplazamiento de reloj:

1.Retrasar el reloj.
2.Demora los datos.

1.Retrasar el reloj
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Podemos retrasar el reloj entre flip-flops adyacentes tales que todos los bordes del reloj llega al mismo tiempo.El inconveniente en este Methos es que podemos perder un reloj de los bordes, mientras que algunos de sincronización.

2.El retraso de datos
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El segundo método es para demorar la llegada de datos entre los dos flip-flops.Así, los relojes de llegar con retraso y los datos se retrasa y sincronizada con los bordes de reloj.

 

[dsairajkiran]

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