Algunos problemas en el establecimiento de limitaciones de diseño de DDR en Allegro?

G

gr1x

Guest
Estoy definiendo una tabla con una ranura DDR.Como no hay muchas limitaciones que tengo que poner en Allegro 15.0, expecially sobre "la longitud de grabado total" y "retardo de propagación relativa".
He encontrado estos pasos en tedioso cuando las restricciones establecidas.

U1.E5 R1.1 -------- ----------------- ------------- R1.2 J3.3 J3.3 R2.1------------
| MCU | -----------> | resistencia de serie | ------------> | SO-DIMM | -------> | R paralelo
-------- D0 neto ------------------ ------------- DA0 neto DA0 Net ----- ------

cuando me puse "longitud de grabado total", como componente de J3 de Pin 3 es una almohadilla, Allegro tratar la traza de R1.2 a R2.1 resistencia de resistencia como la red de algunos, así que he editar manualmente la propiedad DA0 neto neto, escribir "R1.2: J3.3: 500:600", para establecer la longitud entre R1.2 a J3.3 (J3 SODIMM ranura pin 3) con 500mils a 600mils.Después de que he laied a cabo la traza entre R1.2 a J3.3, entonces he de corregir la característica DA0 neto de nuevo, escribir "J3.3: R2.1: 400:500".Es molesto y perdiendo el tiempo para hacer todos estos trabajos.Pero si yo no establecer estas limitaciones, no voy a saber si la huella que el diseño se encuentra dentro de la restricción de longitud.

Sé allegro puede mostrar la longitud dinámica cuando laied la traza en primer lugar, pero cuando puedo ajustar la traza (por ejemplo, la "serpiente" esta huella), Allegro no mostró ninguna información acerca de seguimiento de longitud.Así que he de fijar las reglas abovue manualmente.

Es allí de todos modos para simplificar estos pasos en Allegro?No estoy usando sepcctra, ¿no hay alguna manera de igualar neto es Allegro?

 
Sí lo es.
Usted debe usar RPD en este caso y Xnets uso de la propiedad, entonces se puede asignar una red como por ejemplo, tu objetivo CLK y la vía manualmente DDR redes con respecto a este objetivo con un valor de RPD.

Recuerdos,
M

 

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