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sincrónica y asincrónica

Autor Tema: sincrónica y asincrónica  (Leído 475 veces)

s_vlsi

  • Visitante
sincrónica y asincrónica
« en: Septiembre 03, 2007, 10:21:29 am »
¿Puede alguien decirme la diferencia entre el reinicio sincrónica y aynsynchronous con el código verilog?
reset que debemos ir buscando?

PreguntaThanks & Regards


electrónica foro

sincrónica y asincrónica
« en: Septiembre 03, 2007, 10:21:29 am »

sree205

  • Visitante
sincrónica y asincrónica
« Respuesta #1 en: Septiembre 03, 2007, 10:21:29 am »
u ¿Por qué no leer el documento sobre restablece por Cummings Clifford?este vínculo tiene un papel en restablece, esto ayudará a su comprensión.

http://www.sunburst-design.com/papers/


louisnells

  • Visitante
sincrónica y asincrónica
« Respuesta #2 en: Septiembre 03, 2007, 10:21:29 am »
En un reset síncrono que está pasando únicamente cuando el reloj está activo (ya sea en curso o ve pulso va VE).es decir: hay que poner la señal de reinicio hasta que el reloj de muestras borde él.
Pero en restablecer restablecer asincrónica ocurre instantáneamente.


zainmirza

  • Visitante
sincrónica y asincrónica
« Respuesta #3 en: Septiembre 03, 2007, 10:21:29 am »
plz escribir también ABT es decir, la transmisión síncrona y asíncrona de la transmisión.


louisnells

  • Visitante
sincrónica y asincrónica
« Respuesta #4 en: Septiembre 03, 2007, 10:21:29 am »
Si la transmisión es synchrounous habrá alguna señal de referencia (reloj), lo que hace que los compañeros que participan en el paso de comunicación al unísono.La conexión ICSP del programador PIC a la LC es sincrónica, porque no hay un reloj de referencia en ICSP.
En la transmisión asíncrona no habrá ninguna señal refernce tal.Por ejemplo RS232 ninguna señal de reloj a todos.

zainmirza escribió:

plz escribir también ABT es decir, la transmisión síncrona y asíncrona de la transmisión.

dsocer

  • Visitante
sincrónica y asincrónica
« Respuesta #5 en: Septiembre 03, 2007, 10:21:29 am »
síncronos: siempre @ (clk posedge)
empezar
if (RST == 0) ......
otra cosa ..............
final

asincrónica: siempre @ (clk posedge o RST negedge)

Creo que es mejor sincrónica en la mayoría de las aplicaciones.


sree205

  • Visitante
sincrónica y asincrónica
« Respuesta #6 en: Septiembre 03, 2007, 10:21:29 am »
Funda de obtener una entrada asíncrona, la manera de hacer que la sincronización sin metaestabilidad flop es duplicar la entrada asincrónica y utilizar la salida del segundo fracaso en el diseño.

El mismo método también se aplica a una señal que atraviesa de un dominio de reloj a otro.


shankarmit

  • Visitante
sincrónica y asincrónica
« Respuesta #7 en: Septiembre 03, 2007, 10:21:29 am »
Perdí mi Asynchornous es independiente del reloj y restablecer actuará ..

utilizar si reset = 1, entonces ..elsif (alway (a) de reloj) ..En .. reset síncronosólo si el reloj está activa (Postive o negativo) ..y restablecer actuará

if (alwy (a) clocl)
if (reset) ..

lo siento, no soy bueno en verilog ..u escribir de esta manera ..Recuerdos
Shankar


eelinker

  • Visitante
sincrónica y asincrónica
« Respuesta #8 en: Septiembre 03, 2007, 10:21:29 am »
En el nombre de ---
diferencias registradas son:
1) asynchronus no tiene reloj y sobre la base de las puertas en lugar de retrasar flip-flop.
2) asynchronus no es compatible con herramientas de CAD, por lo que no es prudente para el diseño asíncrono.
3) Para más información sobre el diseño asíncrono se refieren a ASCnotes.pdf en la web.
recuerdos


vcnvcc

  • Visitante
sincrónica y asincrónica
« Respuesta #9 en: Septiembre 03, 2007, 10:21:29 am »
algunos puntos sincronización restablecer aprox.y asincrónica

1.Perdí mi Asynch es rápida en comparación con la sincronización, requiere menos hardware, requiere menos poder, pero
lo más probable es que en caso de violación calendario para el reajuste de Async.


bansalr

  • Visitante
sincrónica y asincrónica
« Respuesta #10 en: Septiembre 03, 2007, 10:21:29 am »
Plz ir al enlace de abajo para tener más discusión acerca de la sincronización asíncrona vs

http://www.deepchip.com/items/0396-01.html


kaustubhkhole

  • Visitante
sincrónica y asincrónica
« Respuesta #11 en: Septiembre 03, 2007, 10:21:29 am »
Reloj y sin reloj!
Esta es la definición más sencilla .....


Haytham

  • Visitante
sincrónica y asincrónica
« Respuesta #12 en: Septiembre 03, 2007, 10:21:29 am »
Hola
Reset sincrónico significa el restablecimiento de la muestra con el borde de reloj (ya sea pos o neg)
Si bien los medios para restablecer Asynchronous restablece cuando nunca la condición de restauración se encuentra activa.
Una cuestión importante en reset asíncrono es que debe eliminarse e synchrnously de la entrada de reset del módulo y se considera como una cuestión sobre la integración de sistemas.

Verilog la siguiente es correcta

Cita:

síncronos: siempre @ (clk posedge)

empezar

if (RST == 0) ......

otra cosa ..............

finalasincrónica: siempre @ (clk posedge o RST negedge)

erudito

  • Visitante
sincrónica y asincrónica
« Respuesta #13 en: Septiembre 03, 2007, 10:21:29 am »
Entender las palabras:
Síncrono
&
Asincrónico

A continuación, comprender la base de síncrono y asíncrono - nada.

Erudito


electrónica foro

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