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girih192002
Antigüedad: 04 de agosto 2007
Publicaciones: 19
|  26 de octubre 2007 13:38 on-chip PIC | | |
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| He LDO diseño del regulador de voltaje de 1.5V para la oferta regulada con 40 mA de corriente de salida máx. Pero tengo problemas cuando me conecto con mi LDO este módulo de chip de otros. está dando oscilliatig salida regulada de tensión de 1,5 V con I level.while contactar 0.1uF condensador. es decir, fuera de chip que está trabajando bien. la cosa es que no puedo conectar 0.1uF fuera chip.beacause, tengo que este módulo de diseño con el módulo de diseño.
azada voy a superar este problema ..... ? cualquier órgano supe entonces por favor hágamelo saber .. |
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aryajur
Antigüedad: 23 de octubre 2004
Posts: 689
Ayudado: 73
Ubicación: Sunnyvale, EE.UU.
| 27 de octubre 2007 10:04 ldo en chip | | |
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| | Usted necesita encontrar una manera de compensar el regulador en una mejor manera. La manera de compensar todo dependerá del tipo de topología que está utilizando. Todos los libros de diseño IC Devices habla mucho de la indemnización, de lo contrario puede publicar su topología de aquí y podemos discutir y probar los sistemas de indemnización. |
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girih192002
Antigüedad: 04 de agosto 2007
Publicaciones: 19
| 27 de octubre 2007 14:21 el regulador de LDO chip | | |
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| Gracias por comentario.
aquí, he adjuntar mi archivo de diseño de los POT. Realmente o puede ser soy incapaz de entender el concepto de la RSE y la forma de compensar el circuito. Así que ustedes por favor me ayude a resolver estos problema. He ganancia de bucle abierto alrededor de 55 dB ganancia de bucle y cierre es de alrededor de 7 dB. Por favor, déjame know.band tensión de referencia brecha es de 0,9 voltios y tensión de alimentación es 2.2volts.
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hung_wai_ming@hotmail.com
Antigüedad: 05 de enero 2004
Posts: 376
Ayudado: 39
| 27 de octubre 2007 14:30 polo dominante NMOS regulador de la indemnización | | |
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| Utiliza PMOS de salida. Se requiere siempre un límite de salida para la compensación polo dominante, de modo que su diseño es ya fracasó en su enfoque.
Usted debe utilizar la compensación de tapa Miller para que el amplificador es el polo dominante de modo que necesita menos de la PAC para la producción, o U NMOS utilizar como salida para alejarse aún más el polo de producción en la producción. Definitivamente, su diseño será probablemente no |
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watersky
Antigüedad: 20 de agosto 2004
Posts: 78
Ayudado: 2
| 27 de octubre 2007 14:34 OGP diseño de regulador de voltaje | | |
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| | Creo que su circuito equivalente no es correcta. El chip de otro no es 0.1uF cuando funciona, o necesita más actual. |
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girih192002
Antigüedad: 04 de agosto 2007
Publicaciones: 19
| 29 de octubre 2007 6:58 indemnización op regulador | | |
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| | hung_wai_ming (at) hotmail.com escribió: | Utiliza PMOS de salida. Se requiere siempre un límite de salida para la compensación polo dominante, de modo que su diseño es ya fracasó en su enfoque.
Usted debe utilizar la compensación de tapa Miller para que el amplificador es el polo dominante de modo que necesita menos de la PAC para la producción, o U NMOS utilizar como salida para alejarse aún más el polo de producción en la producción. Definitivamente, su diseño será probablemente no |
Hola,
¿Puede usted decirme cómo debo hacer las cosas para compensar el circuito. yo realmente no puede entender el concepto de compensación molinero y el polo dominante. así, chicos me pueden ayudar a hacer esto ..? Estoy leyendo concepto de compensación Miller .. |
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Qutang
Antigüedad: 25 de octubre 2004
Posts: 315
Ayudado: 6
| 29 de octubre 2007 9:31 ¿cómo hacer que su perfil de nuevo a 0,1 | | |
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| | res de su red a fin de baja. |
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hung_wai_ming@hotmail.com
Antigüedad: 05 de enero 2004
Posts: 376
Ayudado: 39
| 29 de octubre 2007 11:54 cómo suprimir fuera 0.1uF chip en el chip PIC regulador de tensión | | |
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| Para ser sincero, su diseño es un diseño conceptual, con valores de resistencia muy pequeño de votos (460/500), una gran corriente y ningún camino desactivar, con grandes pérdidas al fin. Su PMOS de salida es demasiado pequeño (W / L = 90u/0.13u), ¿cómo puede ofrecer u 40mA, pero todavía puede saturar su PMOS? No puedo creer que
Usted SRAM utiliza l = 0.13u, ¿por qué? No lo veo mal?
Ha 100ohm conectado en serie con tapa = 10p, ¿por qué? Se crea una onda grande!
Y 10p para compensar la poli? ¿Cómo es que, demasiado pequeño!
Básicamente, me gustaría examinar este es un diseño totalmente errónea y debe oscilar. Did u simular la PM? |
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rajanarender_suram
Antigüedad: 20 de enero 2006
Posts: 188
Ayudado: 15
| 30 de octubre 2007 6:55 cómo suprimir fuera 0.1uF chip en el chip PIC regulador de tensión | | |
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| girih ..
Trate de usar NMO pasar elemento de su diseño (etapa de salida) en lugar de OGP (desde OGP requiere tapa de salida que se conecta de indemnización, mientras que doesnot NMOS), y compensar adecuadamente su SRAM |
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Google
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| 30 de octubre 2007 6:55 Anuncios | | |
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arghpok
Antigüedad: 13 de febrero 2007
Mensajes: 38
Ayudó a: 1
| 27 de diciembre 2007 18:07 Re: Cómo suprimir fuera 0.1uF chip en el chip PIC tensión regul | | |
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| Esto es simplemente no es posible. Estoy totalmente de acuerdo con Huang. Si desea fuente de 40 mA de corriente, su relación de aspecto debe ser 32000 / 1 aprox. Obviamente no la tenía. ¿Dónde está tu técnica de compensación? Sólo veo un amplificador de error típico (no como un típico hecho) usando una gorra de Miller, y luego la etapa de salida. Estas resistencias, dependiendo de la corriente de reposo que desee y la zona se puede gastar en elementos Onchip pasivo, podría ser del orden de 100 ~ 500 kOhms.
Si cambia de elemento de pasar por un NMOS o una configuración Darlington NPN, ya no estamos hablando y LDO, sino un regulador lineal con gran deserción escolar y por lo tanto effiency baja.
Tal vez usted debería leer los libros de administración de energía primero y también echar un vistazo a la base de datos IEEE.
PAZ PARA COLOMBIA! |
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